User:Rkuruvil: Difference between revisions
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** Blockkondensatoren für alle DAC Ausgänge (nahe an Spikey) |
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** Jeweils Jumper um statt 3.3V und 5V von FPGA auch Labornetzteil nutzen zu können |
** Jeweils Jumper um statt 3.3V und 5V von FPGA auch Labornetzteil nutzen zu können |
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** Erzeugen der Terminierungsspannung? |
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** GND Pins der Stecker |
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** AGND für DAC und ADC gut genug? |
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** vias unter Kühlkörper für Spannnungsregler |
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Revision as of 15:02, 2 July 2010
Ranjeet-Board Anmerkungen/Checkliste
großes Board
- Schematic
- Inverter für Reset/EN ??
- Spannungsversorgung CPLD
- Reset CPLD?
- Jumper um Vm mit GND zu verbinden
- Jumper um Vrest mit GND zu verbinden
- Ausgangswiderstand der DACs ausreichend klein?
- Blockkondensatoren für alle DAC Ausgänge (nahe an Spikey)
- Jeweils Jumper um statt 3.3V und 5V von FPGA auch Labornetzteil nutzen zu können
- Erzeugen der Terminierungsspannung?
- RC-Filter für externe Spannungen außer Vrest
- Layout
- Power Leitungen dicker
- Ausreichend Pins/Pads für debugging
- GND Pins der Stecker
- AGND für DAC und ADC gut genug?
- vias unter Kühlkörper für Spannnungsregler
- Kleines Board
- Schematic
Layout
- Bei 1 Spikey Version möglicherweise zum Schluss Vias verschieben
